Xilinx Virtex-5 FPGA ML561 Handbücher

Bedienungsanleitungen und Benutzerhandbücher für Hardware Xilinx Virtex-5 FPGA ML561.
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Xilinx Virtex-5 FPGA ML561 Bedienungsanleitung (140 Seiten)

Marke: Xilinx | Kategorie: Hardware | Größe: 9.61 MB |

Inhaltsverzeichnis

Virtex-5 FPGA ML561

Memory Interfaces

Development Board

Revision History

Table of Contents

Chapter 6: Configuration

Appendix A: FPGA Pinouts

Appendix C: LCD Interface

About This Guide

Additional Support Resources

Conventions

Terminology

Preface: About This Guide

Introduction

Chapter 1: Introduction

Getting Started

Applying Power to the Board

Hardware Description

DDR400 SDRAM Components

DDR2 DIMM

DDR2 SDRAM Components

QDRII SRAM

RLDRAM II Devices

Memory Details

DDR2 SDRAM DIMM

QDRII and RLDRAM II Memories

External Interfaces

200 MHz LVPECL Clock

SMA Clock

33 MHz Clock

GTP Clocks

General-Purpose Headers

DIP Switch

Seven-Segment Displays

Light Emitting Diodes (LEDs)

Pushbuttons

Power On or Off Slide Switch

Soft Touch Probe Points

Power Measurement Header

Power Regulation

Voltage Regulators

Board Design Considerations

Electrical Requirements

Power Consumption

FPGA Internal Power Budget

Chapter 5

Configuration

1. X = Supported

2. — = Not applicable

System ACE Interface

Chapter 6: Configuration

ML561 Hardware-Simulation

Correlation

Test Setup

UG199_c7_01_062707

Table 7-3: DIP[1:2] Settings

Voltage (mV)

Time (ps)

(DDR2 Memory Via)

Time (ns)

DDR2 Component Read Operation

Cursor 1: 697.1 mV, 1.2345 ns

Cursor 2: 774.6 mV, 2.5191 ns

UG199_c7_21_071907

UG199_c7_30_071907

QDRII Write Operation

QDRII Read Operation

Summary and Recommendations

FPGA Pinouts

FPGA #1 Pinout

FPGA #2 Pinout

100

Appendix A: FPGA Pinouts

102

FPGA #3 Pinout

108

Bill of Materials

115

Appendix B: Bill of Materials

116

UG199 (v1.2.1) June 15, 2009

117

LCD Interface

119

Hardware Schematic Diagram

120

Peripheral Device KS0713

121

Controller

122

LCD Panel

122

LED Backlight

122

128 x 64 DOTS

122

Controller – Operation

123

Appendix C: LCD Interface

124

UG199_C_05_050106

126

♦ The LCD bias is set to:

129

Instruction Set

130

Design Examples

134

Display Command Byte

135

UG199_C_09_050106

136

Array Connector Numbering

139

ChipScope PLB46 IBA v1.00a Bedienungsanleitung Englisch

Xilinx ChipScope PLB46 IBA v1.00a User Manual, 13 Seiten SP605 Bedienungsanleitung Englisch

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